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vhDl wAit until

这么写是肯定不行的,wait和wait for和wait until等语句最好只用在testbench里面, 像你这种模块里面不要用。 这段CODE典型的C写惯了跑来写VHDL。。。 我大概明白楼主想要实现的东西,改了下CODE写在下面: signal counter : integer := 0; proc...

WAIT语句中的激活条件决定进程体是否进入仿真状态,而IF语句则是在仿真过程中才判断其条件,并且仿真相应的部分语句(then或者else的部分语句)。 差别在于WAIT语句满足条件后,整个进程体都会被仿真;而IF语句的条件被满足后,只仿真一部分语句...

你在用软件的思路设计硬件,是不会有结果的。 因为软件是顺序执行的,硬件是并行工作的。 你的设计实体要有输入信号,你想让输出信号SPI_CS每个周期(200ns)输出170ns低电平,30ns高电平,那就设计一个输入时钟信号clk,周期为10ns,设计计数器为...

wait on 应该是不可综合的HDL 可综合的好像只有wait until 好久不用忘了 查下书吧 或者百度一下 可综合vhdl

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